UP简历 小U

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个人总结

资深半导体工程师,在半导体器件设计、工艺集成与良率优化方面拥有<strong>5年以上</strong>的丰富经验。精通CMOS、FinFET等先进工艺,熟练运用TCAD仿真、SPICE建模及失效分析技术。具备卓越的问题解决能力和跨团队协作精神,致力于通过技术创新推动产品性能提升与成本优化,为公司创造显著价值。期待在半导体领域持续深耕,迎接更多技术挑战。

工作经历

高级半导体工艺工程师

中芯国际集成电路制造有限公司

2021-07 - 2024-06
  • 主导14nm/7nm FinFET工艺节点的器件集成与良率提升项目,通过优化源漏区注入与退火工艺,成功将器件阈值电压波动降低15%,显著提升产品性能。
  • 负责关键工艺步骤(如刻蚀、薄膜沉积)的参数优化,基于DOE实验设计与统计分析,将晶圆良率从90%提升至95%,直接为公司节省数百万生产成本
  • 利用TCAD仿真工具(Sentaurus TCAD)进行新器件结构设计与工艺方案验证,预测器件性能并指导实验,将新工艺开发周期缩短10%
  • 与设计团队紧密协作,参与PDK开发与验证,确保设计规则与工艺能力匹配,成功支持3个新产品流片
  • 开展失效分析(FA)与根本原因分析(RCA),解决生产线上的复杂工艺问题,减少批次报废率20%

半导体研发工程师

华为海思半导体有限公司

2019-07 - 2021-06
  • 参与28nm CMOS图像传感器项目的研发,负责像素单元结构优化,通过仿真与实验验证,将光电转换效率提升8%
  • 进行新型栅氧介质材料的研究与评估,通过电学测试与可靠性分析,筛选出2种具有潜在应用价值的材料,为下一代工艺节点提供技术储备
  • 熟练操作半导体工艺设备(如PECVD、PVD、RIE),进行薄膜制备与刻蚀实验,积累了丰富的实践经验。
  • 撰写技术报告与专利申请文件,协助团队申请3项发明专利,其中1项已授权
  • 参与国际学术会议2次,与业界专家交流前沿技术,拓宽视野。

教育背景

清华大学

硕士 · 微电子学与固体电子学

2016-09 - 2019-06

北京大学

本科 · 材料科学与工程

2012-09 - 2016-06

技能专长

<strong>半导体工艺</strong>

CMOS · FinFET · 器件集成 · 良率优化 · 光刻 · 刻蚀 · 薄膜沉积 · 离子注入

<strong>仿真与建模</strong>

TCAD (Sentaurus) · SPICE · MATLAB · Python (数据处理)

<strong>测试与分析</strong>

失效分析 (FA) · 电学特性测试 · 可靠性分析 · 材料表征 (SEM, TEM, XPS)

<strong>项目管理</strong>

DOE实验设计 · SPC统计过程控制 · FMEA · 跨部门协作

热门进阶2025/8/11

半导体工程师简历范文

半导体工程师 制造业 3-5年经验

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核心亮点

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适用人群

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