小柚

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个人总结

电子信息工程专业应届生,专注嵌入式底层开发与软硬件协同设计。熟悉C/C++及RTOS内核机制,具备FPGA逻辑验证与驱动开发实战经验。在校期间参与两项军工级仿真项目,代码规范严谨,善于在资源受限环境下优化系统性能,渴望投身航空航天领域贡献技术力量。

工作经历

嵌入式软件开发实习生

中国航空工业集团某研究所

2025-07 - 2025-10
  • 参与某型航电通信模块的驱动移植工作,基于ARM Cortex-M4架构编写UART、SPI等外设驱动,将数据吞吐率提升至1.2Mbps。
  • 协助资深工程师进行FreeRTOS任务调度优化,通过调整优先级策略,将关键控制指令的响应延迟从15ms降低至8ms以内。
  • 负责编写硬件抽象层(HAL)接口文档,累计输出技术文档20余篇,确保软硬件接口定义清晰,减少联调沟通成本约30%。

项目经历

基于FPGA的多通道数据采集系统

西电嵌入式系统实验室

2024-09 - 2025-01
  • 主导Verilog逻辑代码编写,实现4路高速ADC数据的实时采集与缓存,利用FIFO机制解决跨时钟域数据丢失问题,系统稳定性达到99.9%。
  • 设计Nios II软核处理器与FPGA逻辑的通信接口,完成C语言上位机程序开发,实现数据波形实时显示,采样频率最高支持20MHz。
  • 针对存储资源受限问题,优化数据压缩算法,在保持精度前提下将片上SRAM占用率从85%降低至60%。

无人机飞控姿态解算算法移植

全国大学生电子设计竞赛项目组

2024-03 - 2024-08
  • 负责将MATLAB验证过的姿态解算算法移植至STM32平台,通过定点数运算替代浮点运算,使单帧解算时间缩短40%,满足200Hz控制频率需求。
  • 调试MPU6050传感器数据,设计互补滤波算法消除高频噪声,使无人机在3级风扰下的姿态角误差控制在±1.5度以内。
  • 独立完成PCB原理图审查与焊接调试,排查并修复3处电源纹波干扰问题,确保系统在复杂电磁环境下的可靠运行。

教育背景

西安电子科技大学

本科 · 电子信息工程

2022-09 - 2026-06

技能专长

编程语言

C/C++ · Python · Verilog HDL · Assembly

操作系统与中间件

FreeRTOS · uC/OS-II · Linux Driver · CMSIS

硬件开发工具

Altium Designer · ModelSim · Vivado · Keil MDK · IAR EWARM

仪器与调试

示波器 · 逻辑分析仪 · JTAG/SWD调试 · CAN总线分析

专业领域

软硬件协同设计 · 电机控制 · 通信协议栈 · 信号完整性分析

热门入门2026/7/10

嵌入式软件工程师简历范文(军工/航空航天/通信校招)

嵌入式软件工程师 军工/航空航天/通信 应届生

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