小柚

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个人总结

电子信息工程专业应届生,专注FPGA开发与硬件测试方向。熟悉Verilog HDL编程与信号完整性分析,具备扎实的PCB设计基础。在校期间主导多项嵌入式系统项目,拥有自动化测试脚本开发经验,致力于在半导体领域深耕技术。

工作经历

FPGA开发实习生

紫光展锐

2025-07 - 2025-10
  • 参与基带芯片验证模块的Verilog代码编写,独立完成3个状态机逻辑设计,代码覆盖率提升至92%。
  • 协助搭建自动化回归测试环境,利用Python脚本调用示波器接口采集波形数据,将单次测试耗时从45分钟缩短至18分钟。
  • 配合资深工程师进行信号完整性仿真,定位并修复了2处高速信号反射问题,确保时序满足建立保持时间要求。

硬件实验室助理

杭州电子科技大学电子工程学院

2023-09 - 2025-06
  • 管理实验室20余台测试仪器(示波器、频谱仪、逻辑分析仪),制定设备借用与维护规范,设备完好率保持在98%。
  • 协助教师指导低年级学生进行电路焊接与调试培训,累计培训人数超100人,学员竞赛获奖率提升15%。
  • 参与实验室安全巡检与隐患排查,整理归档实验耗材库存数据,优化采购流程使耗材浪费减少20%。

项目经历

基于FPGA的高速数据采集系统设计

杭州电子科技大学实验室

2024-09 - 2025-01
  • 负责系统整体架构设计与Verilog代码实现,采用DDR3缓存机制解决数据吞吐瓶颈,实现1.2Gbps稳定传输速率。
  • 使用Altium Designer绘制4层PCB板,优化电源平面分割与阻抗匹配,实测信噪比达到65dB以上。
  • 设计基于UART的上位机通信协议,实现实时波形显示与参数配置功能,系统误码率低于10^-9。

多通道传感器信号调理与测试平台

全国大学生电子设计竞赛

2024-06 - 2024-08
  • 主导模拟前端电路设计,设计低噪声放大电路与抗混叠滤波器,有效抑制工频干扰,信号动态范围提升40%。
  • 编写LabVIEW测试程序控制程控电源与数字万用表,实现8通道同步采样与自动校准,测试效率提升3倍。
  • 负责系统联调与EMC整改,通过优化接地布局与屏蔽措施,顺利通过静电放电与辐射骚扰测试。

教育背景

杭州电子科技大学

本科 · 电子信息工程

2022-09 - 2026-06

技能专长

硬件开发

Verilog HDL · VHDL · FPGA开发 · Xilinx Vivado · ModelSim

电路设计

PCB设计 · Altium Designer · Cadence Allegro · 信号完整性分析 · EMC/EMI整改

测试测量

示波器操作 · 逻辑分析仪 · 频谱分析仪 · 自动化测试 · LabVIEW

编程语言

Python · C/C++ · MATLAB · Shell脚本

专业技能

DDR3接口设计 · 高速串行协议 · I2C/SPI/UART通信 · 电源完整性仿真

简历范文入门2026/8/19

FPGA/硬件测试工程师简历范文(电子/通信/半导体校招)

FPGA/硬件测试工程师 电子/通信/半导体 应届生

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针对电子/通信/半导体校招场景定制
突出Verilog/VHDL与自动化测试技能
包含示波器操作与信号完整性项目经验

适用人群

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