芯片设计工程师简历模板(半导体/AI校招专用)简历模板预览
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芯片设计工程师简历模板(半导体/AI校招专用)

2026-06-04

专为半导体与人工智能行业校园招聘打造的芯片设计工程师简历模板。突出数字电路设计、Verilog编程、物理综合、封装设计及DFT等核心技能,结构清晰专业,帮助应届生高效展示项目经历与技术能力,轻松通过大厂筛选。

模板亮点

  • 聚焦芯片设计核心技能模块
  • 适配校招场景的项目经历布局
  • 专业技术术语高亮展示
  • 简洁大气的科技风格排版

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#芯片设计工程师简历 #半导体校招简历 #人工智能简历模板 #Verilog简历 #数字电路设计 #应届生求职

适用人群

本模板特别适合芯片设计工程师岗位的求职者使用,具备应届生工作经验的专业人士, 通过技术类风格的设计,帮助您在半导体/人工智能 行业中脱颖而出,展现专业形象和核心竞争力。

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模板内容

小柚

13800138000|xiaoyou_chip@163.com|上海

个人总结

微电子专业应届生,专注数字集成电路前端设计与验证。熟悉从RTL编码到物理综合的全流程,具备扎实的Verilog编程能力与DFT可测性设计经验。在实习期间参与过AI加速芯片模块开发,对低功耗设计与时序收敛有深入理解,渴望在半导体领域深耕技术。

工作经历

数字IC设计实习生

地平线机器人

2025-07 - 2025-10
  • 参与新一代边缘AI芯片中卷积神经网络加速器的RTL设计与仿真,独立负责数据通路模块的Verilog代码编写,通过流水线优化将关键路径延迟降低15%。
  • 协助完成模块级功能验证,搭建UVM测试环境,编写测试用例覆盖率达到98%,提前两周发现并修复了3处潜在的时序违例问题。
  • 配合后端团队进行逻辑综合与静态时序分析,针对面积约束优化代码结构,使该模块综合面积减少约8%。

项目经历

基于RISC-V的低功耗物联网处理器设计

电子科技大学微电子实验室

2024-09 - 2025-06
  • 主导一款面向IoT场景的32位RISC-V处理器核设计,完成指令集定义、微架构设计及Verilog实现,支持中断处理与低功耗睡眠模式。
  • 负责DFT(可测性设计)插入,采用扫描链与内建自测试(BIST)技术,使故障覆盖率提升至95%以上,确保芯片量产良率。
  • 在TSMC 28nm工艺库下完成物理综合与时序收敛,工作频率达到500MHz,动态功耗控制在10mW/MHz以内。

高速串行接口SerDes控制器设计

全国大学生集成电路创新创业大赛

2024-03 - 2024-08
  • 设计并实现支持5Gbps速率的SerDes数字控制模块,解决多相位时钟对齐与数据恢复难题,误码率低于1E-12。
  • 使用Synopsys Design Compiler进行逻辑综合,通过多角多况(MMMC)分析确保在不同工艺角下的时序满足要求。
  • 项目最终获得全国总决赛二等奖,设计的IP核被集成至参赛SoC平台并成功流片验证。

教育背景

电子科技大学

本科 · 微电子科学与工程

2022-09 - 2026-06
主修数字集成电路设计、半导体物理、VLSI系统设计等核心课程,GPA 3.8/4.0,连续三年获得校级一等奖学金。

技能专长

设计语言与仿真

Verilog HDL · SystemVerilog · UVM验证方法学 · Tcl脚本

EDA工具链

Synopsys Design Compiler · PrimeTime · VCS · Cadence Genus · Formality

专业技能

数字电路设计 · 逻辑综合 · 静态时序分析(STA) · DFT可测性设计 · 低功耗设计

硬件基础

FPGA原型验证 · RISC-V架构 · AMBA总线协议 · PCB基础

证书资质

Cadence数字IC设计认证工程师

Cadence Design Systems

2025-03

英语六级(CET-6)

教育部教育考试院

2023-12

获奖经历

全国大学生集成电路创新创业大赛 全国二等奖

中国半导体行业协会

2024-08

凭借高性能SerDes控制器设计作品,从全国200余支队伍中脱颖而出。

国家励志奖学金

教育部

2024-10

表彰在学术科研与综合素质方面的优异表现。

电子科技大学优秀毕业生

电子科技大学

2026-06

授予前5%的应届毕业生,肯定其在专业领域的突出潜力。

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